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EDA設(shè)計技巧

時間:2024-06-10 23:05:53 EDA技術(shù)培訓(xùn) 我要投稿

EDA設(shè)計技巧

  1、密碼鎖輸入電路KEYB 0ARD.VHD中對各種分頻信號/信號序列的設(shè)計有獨(dú)到之處。該設(shè)計中,利用一個自由計數(shù)器來產(chǎn)生各種需要的頻率,也就是先建立一個N位計數(shù)器,N的大小根據(jù)電路的需求來決定。N的值越大,電路可以除頻的次數(shù)就越多,這樣就可以獲得更大的頻率變化,以便提供多種不同頻率的時鐘信號。若輸入時鐘為CLK,N位計數(shù)器的輸出為Q[N-1,0],則Q(0)為CLK的2分頻脈沖信號,Q(1)為CLK的4分頻脈沖信號,Q(2)為CLK的6分頻脈沖信號,……Q(N-1)為CLK的2N分頻脈沖信號;Q(5 DOWNT04)取得的是一個脈沖波形序列,其值是依00、01、10、11、00、01周期性變化的,其變化頻率為CLK的25分頻,也就是32分頻。我們利用以上規(guī)律即可得到各種我們所需要頻率的信號或信號序列。

  2、鍵盤輸入去抖電路的設(shè)計程序DEBOUNCING.VHD在實(shí)際系統(tǒng)的開發(fā)中有較好的參考價值。

  3、密碼鎖控制電路CTRL,VHD中對于數(shù)據(jù)的更新及移位方法比較好。程序中使用語句“ACC <=ACC(11 DOWNT0 0)&DATA_N”非常簡潔地同時實(shí)現(xiàn)了ACC中的低4位用DATA_N進(jìn)行更新,而高12位用ACC中的原來的低12位左移而來的處理。

  4、在密碼鎖輸入電路等模塊的程序的設(shè)計和仿真中,為了便于觀察一些中間結(jié)果,在程序中增加了一些觀測輸出點(diǎn)。這一設(shè)計技巧,對于較大的程序或多進(jìn)程程序的設(shè)計非常重要。同時在仿真時,為了便于觀測全局結(jié)果,降低了分頻常數(shù)。同理,在進(jìn)行程序仿真時,對于程序中數(shù)目較大的分頻/計數(shù)/計時常數(shù)的修改是非常必要的。

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