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EDA設(shè)計方法
方法：
(1) 前端設(shè)計(系統(tǒng)建模RTL 級描述)后端設(shè)計(FPGAASIC)系統(tǒng)建模。
(2)IP復(fù)用。
(3) 前端設(shè)計。
(4) 系統(tǒng)描述：建立系統(tǒng)的數(shù)學(xué)模型。
(5) 功能描述：描述系統(tǒng)的行為或各子模塊之間的數(shù)據(jù)流圖。
(6)邏輯設(shè)計：將系統(tǒng)功能結(jié)構(gòu)化，通常以文本、原理圖、邏輯圖、布爾表達(dá)式來表示設(shè)計結(jié)果。
(7) 仿真：包括功能仿真和時序仿真，主要驗(yàn)證系統(tǒng)功能的正確性及時序特性。
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