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混合基FFT處理器的設(shè)計與Verilog實(shí)現(xiàn)

時間:2023-03-07 11:10:56 通信工程畢業(yè)論文 我要投稿
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混合基FFT處理器的設(shè)計與Verilog實(shí)現(xiàn)

全部作者: 王靖 曹新民 第1作者單位: 中國科學(xué)院上海應(yīng)用物理研究所 論文摘要: 本文介紹了混合基FFT算法的基本原理,用Verilog語言設(shè)計和實(shí)現(xiàn)了1個6點(diǎn)混合基 FFT處理器,實(shí)驗(yàn)結(jié)果證明本處理器能正確地完成6點(diǎn)FFT變換。 關(guān)鍵詞: 混合基FFT;流水線處理器;可編程邏輯器件;Verilog (瀏覽全文) 發(fā)表日期: 2008年02月25日 同行評議:

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【混合基FFT處理器的設(shè)計與Verilog實(shí)現(xiàn)】相關(guān)文章:

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