2k-8k FFT處理器ROM面積的優(yōu)化

全部作者： 雷艷敏 第1作者單位： 武漢理工大學(xué) 論文摘要： 結(jié)合實(shí)時(shí)高速FFT的實(shí)際需求，硬件設(shè)計(jì)采用多級(jí)串聯(lián)的同步流水線結(jié)構(gòu)、基于SRAM、SDF(single-path delay feedback)、DIF等結(jié)構(gòu)和方法。2k/8k分解為5/6級(jí)radix-4蝶形單元與1級(jí)radix 2蝶形單元級(jí)聯(lián)，設(shè)計(jì)對(duì)存儲(chǔ)旋轉(zhuǎn)因子的ROM規(guī)模進(jìn)行了最佳優(yōu)化處理。整體劃分為多個(gè)模塊，均采用Verilog HDL語(yǔ)言描述，并進(jìn)行了功能1致性仿真驗(yàn)證。 關(guān)鍵詞： FFT，旋轉(zhuǎn)因子，ROM，radix-4 (瀏覽全文) 發(fā)表日期： 2007年03月27日 同行評(píng)議：

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