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采樣率為192kHz的24位AD轉(zhuǎn)換器CS5361原理及應(yīng)用
摘要:CS5361是CRYSTAL公司推出的192kHz采樣率、多位(24位)音頻Δ-ΣA/D轉(zhuǎn)換器,它具有雙通道輸入、采樣率高、動態(tài)范圍大等特點(diǎn),非常適合于高端音響或其它領(lǐng)域的應(yīng)用。文中介紹了CS5361的主要特點(diǎn)、工作原理,并給出了它的典型應(yīng)用實(shí)例。1 CS5361的主要特性
CS5361是CRYSTAL公司推出的114dB、192kHz數(shù)據(jù)輸出率的24位Δ-Σ結(jié)構(gòu)音頻AD轉(zhuǎn)換器,其主要特性如下:
●采用多位Δ-Σ結(jié)構(gòu);
●具有24位轉(zhuǎn)換精度;
●114 dB動態(tài)范圍;
●總諧波失真+噪聲優(yōu)于-105 dB;
●系統(tǒng)采樣率高達(dá)192kHz;
●功耗小于150mW?
●內(nèi)部帶有高通濾波電路或直流失調(diào)電壓標(biāo)定電路;
●內(nèi)帶線性相移數(shù)字抗混濾波器;
●支持5V到2.5V邏輯電平;
●采用差動輸入結(jié)構(gòu);
●具有溢出檢測功能;
●采用24腳SOIC或TSSOP封裝形式。
CS5361是供數(shù)字音頻系統(tǒng)使用的完整的模數(shù)轉(zhuǎn)換器,可完成采樣、模數(shù)轉(zhuǎn)換、抗混濾波等功能,并最終產(chǎn)生以串行模式輸出的、對應(yīng)于左右兩個輸入通道信號的24位采樣數(shù)據(jù),而且其最高數(shù)據(jù)輸出率可高達(dá)192kHz。
CS5361芯片采用具有優(yōu)良噪聲抑制能力的差動輸入結(jié)構(gòu),并采用5階多位Δ-Σ調(diào)制器,同時帶有數(shù)字濾波器和抽樣器,從而避免了需要外部抗混濾波器的麻煩。
2 CS5361的引腳排列及功能
CS5361采用24腳SOIC或TSSOP封裝,引腳排列圖如圖1所示。芯片內(nèi)部結(jié)構(gòu)圖如圖2所示。各引腳的功能如下:
RST:低功耗模式選擇端,低電平有效;
M/ S:主、從模式選擇引腳,該腳為低電平時,芯片為從工作模式;
LRCK:該端可用于決定當(dāng)前串行數(shù)據(jù)屬于左通道還是右通道;
SCLK:串行移位時鐘端口;
MCLK:調(diào)制器和數(shù)字濾波器的時鐘源;
VD:芯片數(shù)字電源;
GND:地參考,必須與模擬地相連;
VL:數(shù)字輸入輸出部分電源;
SDOUT:串行數(shù)據(jù)信號輸出端;
MDIV:時鐘分頻端,該腳為高電平時,主時鐘被2分頻;
HPF:高通濾波器允許端,該腳為低電平時,高通濾波器工作;
I2S/LJ:數(shù)據(jù)輸出格式選擇端,該腳為高電平時,輸出格式為I2S,否則為左對齊輸出格式;
M0、M1:操作模式選擇端;
OVFL:左右通道溢出指示腳;
AINL+,AINL-,AINR+,AINR-:分別為左右通道模擬信號的+、-輸入端;
VA:+5V模擬電源輸入端;
VQ:內(nèi)部靜態(tài)參考電壓,使用時應(yīng)連接濾波器;
REFGND:內(nèi)部采樣電路參考地;
FILT+:內(nèi)部采樣電路參考電壓。
3 基本工作原理
CS5361轉(zhuǎn)換器工作時,應(yīng)根據(jù)工作的具體需要確定工作模式、操作模式、輸出格式、高通濾波模式等工作參數(shù),下面分別介紹這些參數(shù)的意義及設(shè)置方式。
3.1 操作模式及采樣率范圍選擇
CS5361轉(zhuǎn)換器的M1、M0引腳狀態(tài)可用于決定芯片的操作模式,通過設(shè)置適當(dāng)?shù)牟僮髂J剑墒梗茫樱担常叮钡妮敵霾蓸勇剩ǎ疲樱┰冢玻耄龋剑保梗玻耄龋g進(jìn)行選擇。每種操作模式對應(yīng)的采樣率范圍如表1所列。
表1 工作模式與輸出采樣率范圍對應(yīng)表
對于每種操作模式,芯片的性能可能略有差異,例如,工作在單速模式時,CS5361的數(shù)字濾波器的通帶為0~0.47FS,阻帶大于0.58FS,阻帶衰減優(yōu)于95dB,濾波器群延時為12/FS(S);工作在倍速模式時,CS5361的數(shù)字濾波器的通帶為0~0.45FS,阻帶大于0.68FS,阻帶衰減優(yōu)于92dB,濾波器群延時為9/FS(S);工作在四速模式時,CS5361的數(shù)字濾波器的通帶為0~0.24FS,阻帶大于0.78FS,阻帶衰減優(yōu)于97dB,濾波器群延時為5/FS(S),因此,應(yīng)根據(jù)實(shí)際需要適當(dāng)選擇CS5361的操作模式。
3.2 系統(tǒng)時鐘MCLK和MDIV狀態(tài)
當(dāng)CS5361的操作模式確定后,系統(tǒng)時鐘和MDIV的狀態(tài)將決定具體的輸出采樣率(FS)、左右通道時鐘LRCK和串行移數(shù)時鐘頻率(SCLK)。
對于單速模式,其采樣率范圍為2~48kHz,因此,當(dāng)MDIV為0時, MCLK的范圍應(yīng)為512kHz~12288kHz;而當(dāng)MDIV為1時, MCLK的范圍應(yīng)為1024kHz~24576kHz;
對于倍速模式,采樣率范圍為48~96kHz,故在MDIV為0時, MCLK的范圍應(yīng)為6144kHz~12288kHz;為1時MCLK的范圍應(yīng)為12288kHz~24576kHz;
對于四速模式,由于其采樣率范圍為96~192kHz?因此,當(dāng)MDIV為0時,MCLK的范圍應(yīng)為6144 kHz~12288kHz;而當(dāng)MDIV為1時, MCLK的范圍則應(yīng)為12288kHz~24576kHz。
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